基于FPGA的同态加密硬件加速器及其数据处理方法

本发明公开了一种基于FPGA的同态加密硬件加速器，包括FPGA端，FPGA端包括数据传输模块、控制模块、同态加密模块、同态解密模块、数论变换模块和小变大模数转换模块；数据传输模块用于实现FPGA端与上位机之间的数据传输；控制模块用于根据加密或解密操作控制数据在各个模块之间的流向；数论变换模块用于对输入的数据进行数论变换或逆数论变换得到变换后的数据或逆数论变换后的数据；同态加密模块用于对经过变换后的数据进行加密得到密文数据；同态解密模块用于对经过变换后的数据进行解密得到明文数据；小变大模数转换模块用于将多路小位宽模数的密文数据或明文数据转换为一路大位宽模数的数据。提高了同态加解密的计算效率。

《基于FPGA的同态加密硬件加速器及其数据处理方法》是一发明专利，专利号为 2025101092140，当前法律状态为已下证，由重庆邮电大学提出申请，发明人为庞宇;王兵兵;苏文鹏，申请日期为2025-01-23，公开（公告）日期为2025-05-23，国际专利分类号（IPC）为 G06F21/72(2013.01)I;G06F21/76(2013.01)I;G06F21/60(2013.01)I，高新资质：未报高企，所属技术领域包括：FPGA、同态加密、硬件加速器、隐私计算、加密算力、数据安全处理。该专利已下发证书，权利稳定，适合直接办理转让过户，是企业申报高企、项目招投标、质押融资的优质标的。赋翼网提供从选品、尽调、合同签订到官方著录项目变更（过户）的一站式专利转让服务，专业顾问全程协助，确保交易合规、安全、高效。专利摘要：本发明公开了一种基于FPGA的同态加密硬件加速器，包括FPGA端，FPGA端包括数据传输模块、控制模块、同态加密模块、同态解密模块、数论变换模块和小变大模数转换模块；数据传输模块用于实现FPGA端与上位机之间的数据传输；控制模块用于根据加密或解密操作控制数据在各个模块之间的流向；数论变换模块用于对输入的数据进行数论变换或逆数论变换得到变换后的数据或逆数论变换后的数据；同态加密模块用于对经过变换后的数据进行加密得到密文数据；同态解密模块用于对经过变换后的数据进行解密得到明文数据；小变大模数转换模块用于将多路小位宽模数的密文数据或明文数据转换为一路大位宽模数的数据。提高了同态加解密的计算效率。

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